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ASIC及FPGA验证工具供应商Aldec公司最近在其Active-HDL仿真环境中添加了连接Mathworks公司Simulink的协同仿真功能。Aldec的Active-HDL 6.1版允许系统设计师协同仿真Simulink模型及由Active-HDL开发出来的数据逻辑。Aldec声称,协同仿真能使设计师在设计周期内获得更好的效率及无错误代码。
据该公司称,设计师在FPGA里实现DSP功能的数量不断增加,因为可编程、成本效益及能采用现场门结构,适合常被提交给前端处理器的冗余计算任务。
采用协同仿真功能后,系统设计师能在单一环境下验证设计元件。Active-HDL的Simulink协同仿真特性允许HDL成分与Simulink模型共存于集成仿真流程中,包括Matlab算法。
Active-HDL的接口允许DSP设计师选择HDL模块或实体,在用MATLAB和Simulink执行验证过程中作为一个黑箱。系统设计师采用Simulink创建系统描述,然后采用Simulink模块表达HDL成分。
据了解,Active-HDL定价为5,900美元(仅供参考)。
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