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法国巴黎大学的博士研究项目向商用EDA软件转化有了一个大的飞跃。法国EDA初创企业Avertec最近在美国新开了一家办事处,使其晶体管级时序和信号完整性技术又向前跨越了一步。
Avertec将向欧洲客户交付HiTas分层静态时序和信号完整性分析工具,及从晶体管级描述生成RTL模型的Yagle。该公司联合创始人兼首席技术官Anthony Lester表示,Avertec的软件能处理门级设计,但尤其适合大型定制设计的晶体管级分析。其分层设计方法能处理百万门晶体管设计,但用户看起来仍然象平面设计。
Avertec声称,Bull公司采用HiTas和Yagle设计其Olympus处理器,GlobespanVirata公司采用HiTas设计Columbia处理器。目前该公司开设了美国办事处,也正在日本寻求可能的分销商。他表示,“我们的挑战是,采用定制设计的公司数量太少。EDA本来就是一个利基市场,定制设计是利基中的更细分市场。”
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